一、verilog design模型
二、c/c++ design模型
三、阻塞模型和非阻塞模型
四、tempalte和parameter
vivado hls的template模板的参数，类似verilog的parameter参数！
图中调用shift_reg设置不同的ID
其目的是让两次函数调用不共用static的变量！
五、带使能的shift模块
news
2026/4/23 7:31:01
vivado hls设计中的一些模型
张小明
前端开发工程师
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